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Model Checking Contest 2018
8th edition, Bratislava, Slovakia, June 26, 2018
Execution of r225-ebro-152732379600096
Last Updated
June 26, 2018

About the Execution of ITS-Tools.L for BridgeAndVehicles-PT-V50P50N10

Execution Summary
Max Memory
Used (MB)		 Time wait (ms) CPU Usage (ms) I/O Wait (ms) Computed Result Execution
Status
15752.240 3600000.00 6612288.00 749.30 TF?FFFFTFFFFFFFF normal

Execution Chart

We display below the execution chart for this examination (boot time has been removed).

Trace from the execution

Waiting for the VM to be ready (probing ssh)
....................
/home/mcc/execution
total 2.8M
-rw-r--r-- 1 mcc users 9.8K May 15 18:54 CTLCardinality.txt
-rw-r--r-- 1 mcc users 38K May 15 18:54 CTLCardinality.xml
-rw-r--r-- 1 mcc users 172K May 15 18:54 CTLFireability.txt
-rw-r--r-- 1 mcc users 506K May 15 18:54 CTLFireability.xml
-rw-r--r-- 1 mcc users 4.0K May 15 18:49 GenericPropertiesDefinition.xml
-rw-r--r-- 1 mcc users 6.1K May 15 18:49 GenericPropertiesVerdict.xml
-rw-r--r-- 1 mcc users 6.0K May 26 09:26 LTLCardinality.txt
-rw-r--r-- 1 mcc users 20K May 26 09:26 LTLCardinality.xml
-rw-r--r-- 1 mcc users 20K May 26 09:26 LTLFireability.txt
-rw-r--r-- 1 mcc users 58K May 26 09:26 LTLFireability.xml
-rw-r--r-- 1 mcc users 7.9K May 15 18:54 ReachabilityCardinality.txt
-rw-r--r-- 1 mcc users 28K May 15 18:54 ReachabilityCardinality.xml
-rw-r--r-- 1 mcc users 121 May 15 18:54 ReachabilityDeadlock.txt
-rw-r--r-- 1 mcc users 359 May 15 18:54 ReachabilityDeadlock.xml
-rw-r--r-- 1 mcc users 105K May 15 18:54 ReachabilityFireability.txt
-rw-r--r-- 1 mcc users 308K May 15 18:54 ReachabilityFireability.xml
-rw-r--r-- 1 mcc users 3.0K May 15 18:54 UpperBounds.txt
-rw-r--r-- 1 mcc users 6.2K May 15 18:54 UpperBounds.xml
-rw-r--r-- 1 mcc users 5 May 15 18:49 equiv_col
-rw-r--r-- 1 mcc users 10 May 15 18:49 instance
-rw-r--r-- 1 mcc users 6 May 15 18:49 iscolored
-rw-r--r-- 1 mcc users 1.5M May 15 18:49 model.pnml
=====================================================================
Generated by BenchKit 2-3637
Executing tool itstoolsl
Input is BridgeAndVehicles-PT-V50P50N10, examination is LTLFireability
Time confinement is 3600 seconds
Memory confinement is 16384 MBytes
Number of cores is 4
Run identifier is r225-ebro-152732379600096
=====================================================================

--------------------
content from stdout:

=== Data for post analysis generated by BenchKit (invocation template)

The expected result is a vector of booleans
BOOL_VECTOR

here is the order used to build the result vector(from text file)
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-00
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-01
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-02
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-03
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-04
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-05
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-06
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-07
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-08
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-09
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-10
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-11
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-12
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-13
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-14
FORMULA_NAME BridgeAndVehicles-PT-V50P50N10-LTLFireability-15

=== Now, execution of the tool begins

BK_START 1527617133791

Converted graph to binary with : CommandLine [args=[/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.louvain.binaries_1.0.0.201805241334/bin/convert-linux64, -i, /tmp/graph8638468465624384840.txt, -o, /tmp/graph8638468465624384840.bin, -w, /tmp/graph8638468465624384840.weights], workingDir=null]
Built communities with : CommandLine [args=[/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.louvain.binaries_1.0.0.201805241334/bin/louvain-linux64, /tmp/graph8638468465624384840.bin, -l, -1, -v, -w, /tmp/graph8638468465624384840.weights, -q, 0, -e, 0.001], workingDir=null]
Using solver Z3 to compute partial order matrices.
Built C files in :
/home/mcc/execution
Invoking ITS tools like this :CommandLine [args=[/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.itstools.binaries_1.0.0.201805241334/bin/its-ltl-linux64, --gc-threshold, 2000000, -i, /home/mcc/execution/LTLFireability.pnml.gal, -t, CGAL, -LTL, /home/mcc/execution/LTLFireability.ltl, -c, -stutter-deadlock], workingDir=/home/mcc/execution]

its-ltl command run as :

/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.itstools.binaries_1.0.0.201805241334/bin/its-ltl-linux64 --gc-threshold 2000000 -i /home/mcc/execution/LTLFireability.pnml.gal -t CGAL -LTL /home/mcc/execution/LTLFireability.ltl -c -stutter-deadlock
Read 16 LTL properties
Presburger conditions satisfied. Using coverability to approximate state space in K-Induction.
Normalized transition count is 250
// Phase 1: matrix 250 rows 128 cols
invariant :i0:u2:NB_ATTENTE_B_0 + i2:u3:NB_ATTENTE_B_1 + i2:u3:NB_ATTENTE_B_2 + i2:u3:NB_ATTENTE_B_3 + i2:u3:NB_ATTENTE_B_4 + i2:u3:NB_ATTENTE_B_5 + i2:u3:NB_ATTENTE_B_6 + i2:u3:NB_ATTENTE_B_7 + i2:u3:NB_ATTENTE_B_8 + i2:u3:NB_ATTENTE_B_9 + i2:u3:NB_ATTENTE_B_10 + i2:u3:NB_ATTENTE_B_11 + i2:u3:NB_ATTENTE_B_12 + i2:u3:NB_ATTENTE_B_13 + i2:u3:NB_ATTENTE_B_14 + i2:u3:NB_ATTENTE_B_15 + i2:u3:NB_ATTENTE_B_16 + i2:u3:NB_ATTENTE_B_17 + i2:u3:NB_ATTENTE_B_18 + i2:u3:NB_ATTENTE_B_19 + i2:u3:NB_ATTENTE_B_20 + i2:u3:NB_ATTENTE_B_21 + i2:u3:NB_ATTENTE_B_22 + i2:u3:NB_ATTENTE_B_23 + i2:u3:NB_ATTENTE_B_24 + i2:u3:NB_ATTENTE_B_25 + i2:u3:NB_ATTENTE_B_26 + i2:u3:NB_ATTENTE_B_27 + i2:u3:NB_ATTENTE_B_28 + i2:u3:NB_ATTENTE_B_29 + i2:u3:NB_ATTENTE_B_30 + i2:u3:NB_ATTENTE_B_31 + i2:u3:NB_ATTENTE_B_32 + i2:u3:NB_ATTENTE_B_33 + i2:u3:NB_ATTENTE_B_34 + i2:u3:NB_ATTENTE_B_35 + i2:u3:NB_ATTENTE_B_36 + i2:u3:NB_ATTENTE_B_37 + i2:u3:NB_ATTENTE_B_38 + i2:u3:NB_ATTENTE_B_39 + i2:u3:NB_ATTENTE_B_40 + i2:u3:NB_ATTENTE_B_41 + i2:u3:NB_ATTENTE_B_42 + i2:u3:NB_ATTENTE_B_43 + i2:u3:NB_ATTENTE_B_44 + i2:u3:NB_ATTENTE_B_45 + i2:u3:NB_ATTENTE_B_46 + i2:u3:NB_ATTENTE_B_47 + i2:u3:NB_ATTENTE_B_48 + i2:u3:NB_ATTENTE_B_49 + i2:u3:NB_ATTENTE_B_50 = 1
invariant :i1:u1:SUR_PONT_A + i1:u1:CAPACITE + -1'i1:u1:SORTI_B + -1'i1:u4:ATTENTE_B + -1'i1:u4:ROUTE_B = 0
invariant :i0:u2:CONTROLEUR_2 + i0:u2:VIDANGE_1 + i1:u1:CHOIX_1 + i1:u1:CHOIX_2 + i2:u3:CONTROLEUR_1 + i2:u3:VIDANGE_2 = 1
invariant :i1:u1:SUR_PONT_B + i1:u1:SORTI_B + i1:u4:ATTENTE_B + i1:u4:ROUTE_B = 50
invariant :i0:u0:ROUTE_A + i0:u0:ATTENTE_A + i1:u1:SORTI_A + -1'i1:u1:CAPACITE + i1:u1:SORTI_B + i1:u4:ATTENTE_B + i1:u4:ROUTE_B = 50
invariant :i2:u5:COMPTEUR_0 + i2:u5:COMPTEUR_1 + i2:u5:COMPTEUR_2 + i2:u5:COMPTEUR_3 + i2:u5:COMPTEUR_4 + i2:u5:COMPTEUR_5 + i2:u5:COMPTEUR_6 + i2:u5:COMPTEUR_7 + i2:u5:COMPTEUR_8 + i2:u5:COMPTEUR_9 + i2:u5:COMPTEUR_10 = 1
invariant :i0:u2:NB_ATTENTE_A_1 + i0:u2:NB_ATTENTE_A_2 + i0:u2:NB_ATTENTE_A_3 + i0:u2:NB_ATTENTE_A_4 + i0:u2:NB_ATTENTE_A_5 + i0:u2:NB_ATTENTE_A_6 + i0:u2:NB_ATTENTE_A_7 + i0:u2:NB_ATTENTE_A_8 + i0:u2:NB_ATTENTE_A_9 + i0:u2:NB_ATTENTE_A_10 + i0:u2:NB_ATTENTE_A_11 + i0:u2:NB_ATTENTE_A_12 + i0:u2:NB_ATTENTE_A_13 + i0:u2:NB_ATTENTE_A_14 + i0:u2:NB_ATTENTE_A_15 + i0:u2:NB_ATTENTE_A_16 + i0:u2:NB_ATTENTE_A_17 + i0:u2:NB_ATTENTE_A_18 + i0:u2:NB_ATTENTE_A_19 + i0:u2:NB_ATTENTE_A_20 + i0:u2:NB_ATTENTE_A_21 + i0:u2:NB_ATTENTE_A_22 + i0:u2:NB_ATTENTE_A_23 + i0:u2:NB_ATTENTE_A_24 + i0:u2:NB_ATTENTE_A_25 + i0:u2:NB_ATTENTE_A_26 + i0:u2:NB_ATTENTE_A_27 + i0:u2:NB_ATTENTE_A_28 + i0:u2:NB_ATTENTE_A_29 + i0:u2:NB_ATTENTE_A_30 + i0:u2:NB_ATTENTE_A_31 + i0:u2:NB_ATTENTE_A_32 + i0:u2:NB_ATTENTE_A_33 + i0:u2:NB_ATTENTE_A_34 + i0:u2:NB_ATTENTE_A_35 + i0:u2:NB_ATTENTE_A_36 + i0:u2:NB_ATTENTE_A_37 + i0:u2:NB_ATTENTE_A_38 + i0:u2:NB_ATTENTE_A_39 + i0:u2:NB_ATTENTE_A_40 + i0:u2:NB_ATTENTE_A_41 + i0:u2:NB_ATTENTE_A_42 + i0:u2:NB_ATTENTE_A_43 + i0:u2:NB_ATTENTE_A_44 + i0:u2:NB_ATTENTE_A_45 + i0:u2:NB_ATTENTE_A_46 + i0:u2:NB_ATTENTE_A_47 + i0:u2:NB_ATTENTE_A_48 + i0:u2:NB_ATTENTE_A_49 + i0:u2:NB_ATTENTE_A_50 + i2:u3:NB_ATTENTE_A_0 = 1
Checking formula 0 : !((((X("(((((((((((((((((((((((((((((((((((((((((((((((((((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_1>=1))&&(i1.u4.ATTENTE_B>=1))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_2>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_3>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_4>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_5>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_6>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_7>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_8>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_9>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_10>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_11>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_12>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_13>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_14>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_15>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_16>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_17>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_18>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_19>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_20>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_21>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_22>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_23>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_24>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_25>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_26>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_27>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_28>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_29>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_30>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_31>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_32>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_33>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_34>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_35>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_36>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_37>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_38>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_39>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_40>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_41>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_42>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_43>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_44>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_45>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_46>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_47>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_48>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1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Formula 0 simplified : !((X"(((((((((((((((((((((((((((((((((((((((((((((((((((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_1>=1))&&(i1.u4.ATTENTE_B>=1))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_2>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_3>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_4>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_5>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_6>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_7>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_8>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_9>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_10>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_11>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_12>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_13>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_14>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_15>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_16>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_17>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_18>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_19>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_20>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_21>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_22>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_23>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_24>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_25>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_26>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_27>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_28>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_29>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_30>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_31>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_32>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_33>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_34>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_35>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_36>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_37>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_38>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_39>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_40>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_41>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_42>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_43>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_44>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_45>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_46>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_47>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CAPACITE>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i2.u3.NB_ATTENTE_B_48>=1))&&(i1.u4.ATTENTE_B>=1)))||((((i1.u1.CA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||((((i0.u2.NB_ATTENTE_A_42>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_43>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_44>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_45>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_46>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_47>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_48>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_49>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))||((((i0.u2.NB_ATTENTE_A_50>=1)&&(i0.u2.CONTROLEUR_2>=1))&&(i0.u2.NB_ATTENTE_B_0>=1))&&(i2.u5.COMPTEUR_10>=1)))") U "((((((((((((((((((((((((((((((((((((((((((((((((((((i0.u0.ROUTE_A>=1)&&(i2.u3.NB_ATTENTE_A_0>=1))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_1>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_2>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_3>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_4>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_5>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_6>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_7>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_8>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_9>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_10>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_11>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_12>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_13>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_14>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_15>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_16>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_17>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_18>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_19>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_20>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_21>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_22>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_23>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_24>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_25>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_26>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_27>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_28>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_29>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_30>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_31>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_32>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_33>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_34>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_35>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_36>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_37>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_38>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_39>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_40>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_41>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_42>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_43>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_44>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_45>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_46>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_47>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_48>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_49>=1)))||((i0.u0.ROUTE_A>=1)&&(i0.u2.NB_ATTENTE_A_50>=1)))")
built 6 ordering constraints for composite.
built 715 ordering constraints for composite.
built 175 ordering constraints for composite.
built 1276 ordering constraints for composite.
Running compilation step : CommandLine [args=[gcc, -c, -I/home/mcc/BenchKit//lts_install_dir//include, -I., -std=c99, -fPIC, -O3, model.c], workingDir=/home/mcc/execution]
Compilation finished in 27612 ms.
Running link step : CommandLine [args=[gcc, -shared, -o, gal.so, model.o], workingDir=/home/mcc/execution]
Link finished in 202 ms.
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, ((X((LTLAP0==true)))U(<>((LTLAP1==true))))U((LTLAP2==true)), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 113 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-00 TRUE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ([](<>([]((LTLAP3==true)))))U([]((LTLAP4==true))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 4900 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-01 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
WARNING : LTSmin timed out (>225 s) on command CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP6==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3127 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-03 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP6==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3126 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-04 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, []((LTLAP6==true)), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2778 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-05 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP7==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3027 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-06 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(<>(<>((LTLAP2==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 103 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-07 TRUE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, <>(<>(X([](X((LTLAP8==true)))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 259 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-08 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, [](([](<>((LTLAP9==true))))U(<>((LTLAP10==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3292 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-09 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, []((((LTLAP11==true))U((LTLAP12==true)))U(<>(X((LTLAP13==true))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 307 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-10 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, <>([]((LTLAP14==true))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3374 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-11 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, [](X(((LTLAP15==true))U(<>((LTLAP16==true))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 274 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-12 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP17==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3059 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-13 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, (X((LTLAP18==true)))U([](X((LTLAP19==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 251 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-14 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP20==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3172 ms.
FORMULA BridgeAndVehicles-PT-V50P50N10-LTLFireability-15 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Retrying LTSmin with larger timeout 1800 s
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
WARNING : LTSmin timed out (>1800 s) on command CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]

BK_TIME_CONFINEMENT_REACHED

--------------------
content from stderr:

+ export BINDIR=/home/mcc/BenchKit/
+ BINDIR=/home/mcc/BenchKit/
++ pwd
+ export MODEL=/home/mcc/execution
+ MODEL=/home/mcc/execution
+ /home/mcc/BenchKit//runeclipse.sh /home/mcc/execution LTLFireability -its -ltsminpath /home/mcc/BenchKit//lts_install_dir/ -louvain -smt
+ ulimit -s 65536
+ [[ -z '' ]]
+ export LTSMIN_MEM_SIZE=8589934592
+ LTSMIN_MEM_SIZE=8589934592
+ /home/mcc/BenchKit//itstools/its-tools -consoleLog -data /home/mcc/execution/workspace -pnfolder /home/mcc/execution -examination LTLFireability -z3path /home/mcc/BenchKit//z3/bin/z3 -yices2path /home/mcc/BenchKit//yices/bin/yices -its -ltsminpath /home/mcc/BenchKit//lts_install_dir/ -louvain -smt -vmargs -Dosgi.locking=none -Declipse.stateSaveDelayInterval=-1 -Dosgi.configuration.area=/tmp/.eclipse -Xss8m -Xms40m -Xmx8192m -Dfile.encoding=UTF-8 -Dosgi.requiredJavaVersion=1.6
May 29, 2018 6:05:36 PM fr.lip6.move.gal.application.Application start
INFO: Running its-tools with arguments : [-pnfolder, /home/mcc/execution, -examination, LTLFireability, -z3path, /home/mcc/BenchKit//z3/bin/z3, -yices2path, /home/mcc/BenchKit//yices/bin/yices, -its, -ltsminpath, /home/mcc/BenchKit//lts_install_dir/, -louvain, -smt]
May 29, 2018 6:05:36 PM fr.lip6.move.gal.application.MccTranslator transformPNML
INFO: Parsing pnml file : /home/mcc/execution/model.pnml
May 29, 2018 6:05:37 PM fr.lip6.move.gal.nupn.PTNetReader loadFromXML
INFO: Load time of PNML (sax parser for PT used): 295 ms
May 29, 2018 6:05:37 PM fr.lip6.move.gal.pnml.togal.PTGALTransformer handlePage
INFO: Transformed 128 places.
May 29, 2018 6:05:37 PM fr.lip6.move.gal.pnml.togal.PTGALTransformer handlePage
INFO: Transformed 1328 transitions.
May 29, 2018 6:05:37 PM fr.lip6.move.gal.application.MccTranslator applyOrder
INFO: Applying decomposition
May 29, 2018 6:05:38 PM fr.lip6.move.gal.instantiate.GALRewriter flatten
INFO: Flatten gal took : 694 ms
May 29, 2018 6:05:39 PM fr.lip6.move.gal.instantiate.GALRewriter flatten
INFO: Flatten gal took : 465 ms
Begin: Tue May 29 18:05:39 2018

Computation of communities with the Newman-Girvan Modularity quality function

level 0:
start computation: Tue May 29 18:05:39 2018
network size: 128 nodes, 2030 links, 2656 weight
quality increased from -0.0795692 to 0.216416
end computation: Tue May 29 18:05:39 2018
level 1:
start computation: Tue May 29 18:05:39 2018
network size: 6 nodes, 30 links, 2656 weight
quality increased from 0.216416 to 0.244458
end computation: Tue May 29 18:05:39 2018
level 2:
start computation: Tue May 29 18:05:39 2018
network size: 3 nodes, 9 links, 2656 weight
quality increased from 0.244458 to 0.244458
end computation: Tue May 29 18:05:39 2018
End: Tue May 29 18:05:39 2018
Total duration: 0 sec
0.244458
May 29, 2018 6:05:39 PM fr.lip6.move.gal.instantiate.CompositeBuilder decomposeWithOrder
INFO: Decomposing Gal with order
May 29, 2018 6:05:40 PM fr.lip6.move.gal.instantiate.GALRewriter flatten
INFO: Flatten gal took : 319 ms
May 29, 2018 6:05:40 PM fr.lip6.move.gal.instantiate.CompositeBuilder rewriteArraysToAllowPartition
INFO: Rewriting arrays to variables to allow decomposition.
May 29, 2018 6:05:44 PM fr.lip6.move.gal.instantiate.Instantiator fuseIsomorphicEffects
INFO: Removed a total of 2531 redundant transitions.
May 29, 2018 6:05:44 PM fr.lip6.move.serialization.SerializationUtil systemToFile
INFO: Time to serialize gal into /home/mcc/execution/LTLFireability.pnml.gal : 43 ms
May 29, 2018 6:05:44 PM fr.lip6.move.serialization.SerializationUtil serializePropertiesForITSLTLTools
INFO: Time to serialize properties into /home/mcc/execution/LTLFireability.ltl : 30 ms
May 29, 2018 6:05:44 PM fr.lip6.move.gal.semantics.DeterministicNextBuilder getDeterministicNext
INFO: Input system was already deterministic with 1328 transitions.
May 29, 2018 6:05:45 PM fr.lip6.move.gal.gal2smt.bmc.KInductionSolver computeAndDeclareInvariants
INFO: Computed 7 place invariants in 143 ms
May 29, 2018 6:05:46 PM fr.lip6.move.gal.gal2smt.bmc.KInductionSolver init
INFO: Proved 128 variables to be positive in 1297 ms
May 29, 2018 6:05:46 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeAblingMatrix
INFO: Computing symmetric may disable matrix : 1328 transitions.
May 29, 2018 6:05:46 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of disable matrix completed :0/1328 took 2 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 6:05:47 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Complete disable matrix. took 336 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 6:05:47 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeAblingMatrix
INFO: Computing symmetric may enable matrix : 1328 transitions.
May 29, 2018 6:05:47 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Complete enable matrix. took 186 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 6:06:42 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeCoEnablingMatrix
INFO: Computing symmetric co enabling matrix : 1328 transitions.
May 29, 2018 6:06:45 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(0/1328) took 2217 ms. Total solver calls (SAT/UNSAT): 1303(653/650)
May 29, 2018 6:06:48 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(3/1328) took 5277 ms. Total solver calls (SAT/UNSAT): 5206(998/4208)
May 29, 2018 6:06:51 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(6/1328) took 8469 ms. Total solver calls (SAT/UNSAT): 9100(1343/7757)
May 29, 2018 6:06:55 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(10/1328) took 12527 ms. Total solver calls (SAT/UNSAT): 14278(1803/12475)
May 29, 2018 6:06:59 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(14/1328) took 16372 ms. Total solver calls (SAT/UNSAT): 19440(2263/17177)
May 29, 2018 6:07:03 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(18/1328) took 20299 ms. Total solver calls (SAT/UNSAT): 24586(2723/21863)
May 29, 2018 6:07:06 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(21/1328) took 23609 ms. Total solver calls (SAT/UNSAT): 28435(3068/25367)
May 29, 2018 6:07:10 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(25/1328) took 27570 ms. Total solver calls (SAT/UNSAT): 33553(3528/30025)
May 29, 2018 6:07:13 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(28/1328) took 30710 ms. Total solver calls (SAT/UNSAT): 37381(3873/33508)
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INFO: Computation of co-enabling matrix(31/1328) took 34039 ms. Total solver calls (SAT/UNSAT): 41200(4218/36982)
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May 29, 2018 6:16:40 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(627/1328) took 597724 ms. Total solver calls (SAT/UNSAT): 633182(10409/622773)
May 29, 2018 6:16:43 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(635/1328) took 600814 ms. Total solver calls (SAT/UNSAT): 638730(10409/628321)
May 29, 2018 6:16:47 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(644/1328) took 604208 ms. Total solver calls (SAT/UNSAT): 644895(10409/634486)
May 29, 2018 6:16:50 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(651/1328) took 607399 ms. Total solver calls (SAT/UNSAT): 649634(10409/639225)
May 29, 2018 6:16:53 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(659/1328) took 610509 ms. Total solver calls (SAT/UNSAT): 654990(10409/644581)
May 29, 2018 6:16:56 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(668/1328) took 613769 ms. Total solver calls (SAT/UNSAT): 660939(10409/650530)
May 29, 2018 6:16:59 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(677/1328) took 616909 ms. Total solver calls (SAT/UNSAT): 666807(10409/656398)
May 29, 2018 6:17:02 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(686/1328) took 619937 ms. Total solver calls (SAT/UNSAT): 672594(10409/662185)
May 29, 2018 6:17:05 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(695/1328) took 623067 ms. Total solver calls (SAT/UNSAT): 678300(10409/667891)
May 29, 2018 6:17:09 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(704/1328) took 626177 ms. Total solver calls (SAT/UNSAT): 683925(10409/673516)
May 29, 2018 6:17:12 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(713/1328) took 629206 ms. Total solver calls (SAT/UNSAT): 689469(10409/679060)
May 29, 2018 6:17:15 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(722/1328) took 632283 ms. Total solver calls (SAT/UNSAT): 694932(10409/684523)
May 29, 2018 6:17:18 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(732/1328) took 635412 ms. Total solver calls (SAT/UNSAT): 700907(10409/690498)
May 29, 2018 6:17:21 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(742/1328) took 638474 ms. Total solver calls (SAT/UNSAT): 706782(10409/696373)
May 29, 2018 6:17:24 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(753/1328) took 641676 ms. Total solver calls (SAT/UNSAT): 713129(10409/702720)
May 29, 2018 6:17:27 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(764/1328) took 644892 ms. Total solver calls (SAT/UNSAT): 719355(10409/708946)
May 29, 2018 6:17:30 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(775/1328) took 648039 ms. Total solver calls (SAT/UNSAT): 725460(10409/715051)
May 29, 2018 6:17:34 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(786/1328) took 651194 ms. Total solver calls (SAT/UNSAT): 731444(10409/721035)
May 29, 2018 6:17:37 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(797/1328) took 654293 ms. Total solver calls (SAT/UNSAT): 737307(10409/726898)
May 29, 2018 6:17:40 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(809/1328) took 657451 ms. Total solver calls (SAT/UNSAT): 743565(10409/733156)
May 29, 2018 6:17:43 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(821/1328) took 660509 ms. Total solver calls (SAT/UNSAT): 749679(10409/739270)
May 29, 2018 6:17:46 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(834/1328) took 663721 ms. Total solver calls (SAT/UNSAT): 756140(10409/745731)
May 29, 2018 6:17:49 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(846/1328) took 666864 ms. Total solver calls (SAT/UNSAT): 761954(10409/751545)
May 29, 2018 6:17:52 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(858/1328) took 669870 ms. Total solver calls (SAT/UNSAT): 767624(10409/757215)
May 29, 2018 6:17:55 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(871/1328) took 672927 ms. Total solver calls (SAT/UNSAT): 773604(10409/763195)
May 29, 2018 6:17:58 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(884/1328) took 676000 ms. Total solver calls (SAT/UNSAT): 779415(10409/769006)
May 29, 2018 6:18:01 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(897/1328) took 679036 ms. Total solver calls (SAT/UNSAT): 785057(10409/774648)
May 29, 2018 6:18:05 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(911/1328) took 682161 ms. Total solver calls (SAT/UNSAT): 790944(10409/780535)
May 29, 2018 6:18:08 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(925/1328) took 685260 ms. Total solver calls (SAT/UNSAT): 796635(10409/786226)
May 29, 2018 6:18:11 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(939/1328) took 688297 ms. Total solver calls (SAT/UNSAT): 802130(10409/791721)
May 29, 2018 6:18:14 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(954/1328) took 691423 ms. Total solver calls (SAT/UNSAT): 807800(10409/797391)
May 29, 2018 6:18:17 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(970/1328) took 694530 ms. Total solver calls (SAT/UNSAT): 813600(10409/803191)
May 29, 2018 6:18:20 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(986/1328) took 697666 ms. Total solver calls (SAT/UNSAT): 819144(10409/808735)
May 29, 2018 6:18:23 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1003/1328) took 700803 ms. Total solver calls (SAT/UNSAT): 824754(10409/814345)
May 29, 2018 6:18:26 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1021/1328) took 703897 ms. Total solver calls (SAT/UNSAT): 830379(10409/819970)
May 29, 2018 6:18:29 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1040/1328) took 706926 ms. Total solver calls (SAT/UNSAT): 835965(10409/825556)
May 29, 2018 6:18:32 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1061/1328) took 710010 ms. Total solver calls (SAT/UNSAT): 841719(10409/831310)
May 29, 2018 6:18:36 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1083/1328) took 713134 ms. Total solver calls (SAT/UNSAT): 847274(10409/836865)
May 29, 2018 6:18:39 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1106/1328) took 716147 ms. Total solver calls (SAT/UNSAT): 852564(10409/842155)
May 29, 2018 6:18:42 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1129/1328) took 719150 ms. Total solver calls (SAT/UNSAT): 857325(10409/846916)
May 29, 2018 6:18:45 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1157/1328) took 722197 ms. Total solver calls (SAT/UNSAT): 862407(10409/851998)
May 29, 2018 6:18:48 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1188/1328) took 725283 ms. Total solver calls (SAT/UNSAT): 867119(10409/856710)
May 29, 2018 6:18:51 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1222/1328) took 728286 ms. Total solver calls (SAT/UNSAT): 871182(10409/860773)
May 29, 2018 6:18:54 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1269/1328) took 731302 ms. Total solver calls (SAT/UNSAT): 874895(10409/864486)
May 29, 2018 6:18:56 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Finished co-enabling matrix. took 733544 ms. Total solver calls (SAT/UNSAT): 876485(10459/866026)
May 29, 2018 6:18:56 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeDoNotAccord
INFO: Computing Do-Not-Accords matrix : 1328 transitions.
May 29, 2018 6:19:04 PM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Completed DNA matrix. took 7525 ms. Total solver calls (SAT/UNSAT): 205(0/205)
May 29, 2018 6:19:04 PM fr.lip6.move.gal.gal2pins.Gal2PinsTransformerNext transform
INFO: Built C files in 799805ms conformant to PINS in folder :/home/mcc/execution

Sequence of Actions to be Executed by the VM

This is useful if one wants to reexecute the tool in the VM from the submitted image disk.

set -x
# this is for BenchKit: configuration of major elements for the test
export BK_INPUT="BridgeAndVehicles-PT-V50P50N10"
export BK_EXAMINATION="LTLFireability"
export BK_TOOL="itstoolsl"
export BK_RESULT_DIR="/tmp/BK_RESULTS/OUTPUTS"
export BK_TIME_CONFINEMENT="3600"
export BK_MEMORY_CONFINEMENT="16384"

# this is specific to your benchmark or test

export BIN_DIR="$HOME/BenchKit/bin"

# remove the execution directoty if it exists (to avoid increse of .vmdk images)
if [ -d execution ] ; then
rm -rf execution
fi

tar xzf /home/mcc/BenchKit/INPUTS/BridgeAndVehicles-PT-V50P50N10.tgz
mv BridgeAndVehicles-PT-V50P50N10 execution
cd execution
pwd
ls -lh

# this is for BenchKit: explicit launching of the test
echo "====================================================================="
echo " Generated by BenchKit 2-3637"
echo " Executing tool itstoolsl"
echo " Input is BridgeAndVehicles-PT-V50P50N10, examination is LTLFireability"
echo " Time confinement is $BK_TIME_CONFINEMENT seconds"
echo " Memory confinement is 16384 MBytes"
echo " Number of cores is 4"
echo " Run identifier is r225-ebro-152732379600096"
echo "====================================================================="
echo
echo "--------------------"
echo "content from stdout:"
echo
echo "=== Data for post analysis generated by BenchKit (invocation template)"
echo
if [ "LTLFireability" = "UpperBounds" ] ; then
echo "The expected result is a vector of positive values"
echo NUM_VECTOR
elif [ "LTLFireability" != "StateSpace" ] ; then
echo "The expected result is a vector of booleans"
echo BOOL_VECTOR
else
echo "no data necessary for post analysis"
fi
echo
if [ -f "LTLFireability.txt" ] ; then
echo "here is the order used to build the result vector(from text file)"
for x in $(grep Property LTLFireability.txt | cut -d ' ' -f 2 | sort -u) ; do
echo "FORMULA_NAME $x"
done
elif [ -f "LTLFireability.xml" ] ; then # for cunf (txt files deleted;-)
echo echo "here is the order used to build the result vector(from xml file)"
for x in $(grep '' LTLFireability.xml | cut -d '>' -f 2 | cut -d '<' -f 1 | sort -u) ; do
echo "FORMULA_NAME $x"
done
fi
echo
echo "=== Now, execution of the tool begins"
echo
echo -n "BK_START "
date -u +%s%3N
echo
timeout -s 9 $BK_TIME_CONFINEMENT bash -c "/home/mcc/BenchKit/BenchKit_head.sh 2> STDERR ; echo ; echo -n \"BK_STOP \" ; date -u +%s%3N"
if [ $? -eq 137 ] ; then
echo
echo "BK_TIME_CONFINEMENT_REACHED"
fi
echo
echo "--------------------"
echo "content from stderr:"
echo
cat STDERR ;