fond
Model Checking Contest 2018
8th edition, Bratislava, Slovakia, June 26, 2018
Execution of r224-ebro-152732378700056
Last Updated
June 26, 2018

About the Execution of ITS-Tools for BridgeAndVehicles-COL-V50P50N10

Execution Summary
Max Memory
Used (MB)
Time wait (ms) CPU Usage (ms) I/O Wait (ms) Computed Result Execution
Status
15752.590 3600000.00 7063723.00 800.30 TF?FFFFTFF?FTFFF normal

Execution Chart

We display below the execution chart for this examination (boot time has been removed).

Trace from the execution

Waiting for the VM to be ready (probing ssh)
.....................
/home/mcc/execution
total 208K
-rw-r--r-- 1 mcc users 3.9K May 15 18:54 CTLCardinality.txt
-rw-r--r-- 1 mcc users 20K May 15 18:54 CTLCardinality.xml
-rw-r--r-- 1 mcc users 3.6K May 15 18:54 CTLFireability.txt
-rw-r--r-- 1 mcc users 20K May 15 18:54 CTLFireability.xml
-rw-r--r-- 1 mcc users 4.0K May 15 18:49 GenericPropertiesDefinition.xml
-rw-r--r-- 1 mcc users 6.1K May 15 18:49 GenericPropertiesVerdict.xml
-rw-r--r-- 1 mcc users 2.7K May 26 09:26 LTLCardinality.txt
-rw-r--r-- 1 mcc users 11K May 26 09:26 LTLCardinality.xml
-rw-r--r-- 1 mcc users 2.2K May 26 09:26 LTLFireability.txt
-rw-r--r-- 1 mcc users 8.2K May 26 09:26 LTLFireability.xml
-rw-r--r-- 1 mcc users 3.7K May 15 18:54 ReachabilityCardinality.txt
-rw-r--r-- 1 mcc users 16K May 15 18:54 ReachabilityCardinality.xml
-rw-r--r-- 1 mcc users 122 May 15 18:54 ReachabilityDeadlock.txt
-rw-r--r-- 1 mcc users 360 May 15 18:54 ReachabilityDeadlock.xml
-rw-r--r-- 1 mcc users 3.6K May 15 18:54 ReachabilityFireability.txt
-rw-r--r-- 1 mcc users 18K May 15 18:54 ReachabilityFireability.xml
-rw-r--r-- 1 mcc users 1.9K May 15 18:54 UpperBounds.txt
-rw-r--r-- 1 mcc users 4.0K May 15 18:54 UpperBounds.xml
-rw-r--r-- 1 mcc users 5 May 15 18:49 equiv_pt
-rw-r--r-- 1 mcc users 10 May 15 18:49 instance
-rw-r--r-- 1 mcc users 5 May 15 18:49 iscolored
-rw-r--r-- 1 mcc users 42K May 15 18:49 model.pnml
=====================================================================
Generated by BenchKit 2-3637
Executing tool itstools
Input is BridgeAndVehicles-COL-V50P50N10, examination is LTLFireability
Time confinement is 3600 seconds
Memory confinement is 16384 MBytes
Number of cores is 4
Run identifier is r224-ebro-152732378700056
=====================================================================


--------------------
content from stdout:

=== Data for post analysis generated by BenchKit (invocation template)

The expected result is a vector of booleans
BOOL_VECTOR

here is the order used to build the result vector(from text file)
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-00
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-01
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-02
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-03
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-04
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-05
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-06
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-07
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-08
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-09
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-10
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-11
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-12
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-13
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-14
FORMULA_NAME BridgeAndVehicles-COL-V50P50N10-LTLFireability-15

=== Now, execution of the tool begins

BK_START 1527556999067

01:23:23.666 [main] ERROR PNML validation - The rng grammar file can't be accessed : www.pnml.org
01:23:23.669 [main] ERROR import - Grammar file errors have been raised, the validation can't be done, process will continue without Grammar validation
Using solver Z3 to compute partial order matrices.
Built C files in :
/home/mcc/execution
Invoking ITS tools like this :CommandLine [args=[/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.itstools.binaries_1.0.0.201805151631/bin/its-ltl-linux64, --gc-threshold, 2000000, -i, /home/mcc/execution/LTLFireability.pnml.gal, -t, CGAL, -LTL, /home/mcc/execution/LTLFireability.ltl, -c, -stutter-deadlock], workingDir=/home/mcc/execution]

its-ltl command run as :

/home/mcc/BenchKit/itstools/plugins/fr.lip6.move.gal.itstools.binaries_1.0.0.201805151631/bin/its-ltl-linux64 --gc-threshold 2000000 -i /home/mcc/execution/LTLFireability.pnml.gal -t CGAL -LTL /home/mcc/execution/LTLFireability.ltl -c -stutter-deadlock
Read 16 LTL properties
Checking formula 0 : !((((X("(((((((((((((((((((((((((((((((((((((((((((((((((((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB1.NB_ATTENTE_B_1>=1))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB2.NB_ATTENTE_B_2>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB3.NB_ATTENTE_B_3>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB4.NB_ATTENTE_B_4>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB5.NB_ATTENTE_B_5>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB6.NB_ATTENTE_B_6>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB7.NB_ATTENTE_B_7>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB8.NB_ATTENTE_B_8>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB9.NB_ATTENTE_B_9>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB10.NB_ATTENTE_B_10>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB11.NB_ATTENTE_B_11>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB12.NB_ATTENTE_B_12>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB13.NB_ATTENTE_B_13>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB14.NB_ATTENTE_B_14>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB15.NB_ATTENTE_B_15>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB16.NB_ATTENTE_B_16>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB17.NB_ATTENTE_B_17>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB18.NB_ATTENTE_B_18>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB19.NB_ATTENTE_B_19>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB20.NB_ATTENTE_B_20>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB21.NB_ATTENTE_B_21>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB22.NB_ATTENTE_B_22>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB23.NB_ATTENTE_B_23>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB24.NB_ATTENTE_B_24>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB25.NB_ATTENTE_B_25>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB26.NB_ATTENTE_B_26>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB27.NB_ATTENTE_B_27>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB28.NB_ATTENTE_B_28>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB29.NB_ATTENTE_B_29>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB30.NB_ATTENTE_B_30>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB31.NB_ATTENTE_B_31>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB32.NB_ATTENTE_B_32>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB33.NB_ATTENTE_B_33>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB34.NB_ATTENTE_B_34>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB35.NB_ATTENTE_B_35>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB36.NB_ATTENTE_B_36>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB37.NB_ATTENTE_B_37>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB38.NB_ATTENTE_B_38>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB39.NB_ATTENTE_B_39>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB40.NB_ATTENTE_B_40>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&&(voitureB41.NB_ATTENTE_B_41>=1)))||((((sens1.CONTROLEUR_1>=1)&&(CAPACITE.CAPACITE_0>=1))&&(ATTENTE_B.ATTENTE_B_0>=1))&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Formula 0 simplified : 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U "((((((((((((((((((((((((((((((((((((((((((((((((((((voitureA0.NB_ATTENTE_A_0>=1)&&(ROUTE_A.ROUTE_A_0>=1))||((voitureA1.NB_ATTENTE_A_1>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA2.NB_ATTENTE_A_2>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA3.NB_ATTENTE_A_3>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA4.NB_ATTENTE_A_4>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA5.NB_ATTENTE_A_5>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA6.NB_ATTENTE_A_6>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA7.NB_ATTENTE_A_7>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA8.NB_ATTENTE_A_8>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA9.NB_ATTENTE_A_9>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA10.NB_ATTENTE_A_10>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA11.NB_ATTENTE_A_11>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA12.NB_ATTENTE_A_12>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA13.NB_ATTENTE_A_13>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA14.NB_ATTENTE_A_14>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA15.NB_ATTENTE_A_15>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA16.NB_ATTENTE_A_16>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA17.NB_ATTENTE_A_17>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA18.NB_ATTENTE_A_18>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA19.NB_ATTENTE_A_19>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA20.NB_ATTENTE_A_20>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA21.NB_ATTENTE_A_21>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA22.NB_ATTENTE_A_22>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA23.NB_ATTENTE_A_23>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA24.NB_ATTENTE_A_24>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA25.NB_ATTENTE_A_25>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA26.NB_ATTENTE_A_26>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA27.NB_ATTENTE_A_27>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA28.NB_ATTENTE_A_28>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA29.NB_ATTENTE_A_29>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA30.NB_ATTENTE_A_30>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA31.NB_ATTENTE_A_31>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA32.NB_ATTENTE_A_32>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA33.NB_ATTENTE_A_33>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA34.NB_ATTENTE_A_34>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA35.NB_ATTENTE_A_35>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA36.NB_ATTENTE_A_36>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA37.NB_ATTENTE_A_37>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA38.NB_ATTENTE_A_38>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA39.NB_ATTENTE_A_39>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA40.NB_ATTENTE_A_40>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA41.NB_ATTENTE_A_41>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA42.NB_ATTENTE_A_42>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA43.NB_ATTENTE_A_43>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA44.NB_ATTENTE_A_44>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA45.NB_ATTENTE_A_45>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA46.NB_ATTENTE_A_46>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA47.NB_ATTENTE_A_47>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA48.NB_ATTENTE_A_48>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA49.NB_ATTENTE_A_49>=1)&&(ROUTE_A.ROUTE_A_0>=1)))||((voitureA50.NB_ATTENTE_A_50>=1)&&(ROUTE_A.ROUTE_A_0>=1)))")
built 339 ordering constraints for composite.
Presburger conditions satisfied. Using coverability to approximate state space in K-Induction.
Normalized transition count is 250
// Phase 1: matrix 250 rows 128 cols
invariant :SUR_PONT_B:SUR_PONT_B_0 + ATTENTE_B:ATTENTE_B_0 + ROUTE_B:ROUTE_B_0 + SORTI_B:SORTI_B_0 = 50
invariant :SORTI_A:SORTI_A_0 + ROUTE_A:ROUTE_A_0 + ATTENTE_A:ATTENTE_A_0 + SUR_PONT_A:SUR_PONT_A_0 = 50
invariant :voitureA0:NB_ATTENTE_A_0 + voitureA1:NB_ATTENTE_A_1 + voitureA2:NB_ATTENTE_A_2 + voitureA3:NB_ATTENTE_A_3 + voitureA4:NB_ATTENTE_A_4 + voitureA5:NB_ATTENTE_A_5 + voitureA6:NB_ATTENTE_A_6 + voitureA7:NB_ATTENTE_A_7 + voitureA8:NB_ATTENTE_A_8 + voitureA9:NB_ATTENTE_A_9 + voitureA10:NB_ATTENTE_A_10 + voitureA11:NB_ATTENTE_A_11 + voitureA12:NB_ATTENTE_A_12 + voitureA13:NB_ATTENTE_A_13 + voitureA14:NB_ATTENTE_A_14 + voitureA15:NB_ATTENTE_A_15 + voitureA16:NB_ATTENTE_A_16 + voitureA17:NB_ATTENTE_A_17 + voitureA18:NB_ATTENTE_A_18 + voitureA19:NB_ATTENTE_A_19 + voitureA20:NB_ATTENTE_A_20 + voitureA21:NB_ATTENTE_A_21 + voitureA22:NB_ATTENTE_A_22 + voitureA23:NB_ATTENTE_A_23 + voitureA24:NB_ATTENTE_A_24 + voitureA25:NB_ATTENTE_A_25 + voitureA26:NB_ATTENTE_A_26 + voitureA27:NB_ATTENTE_A_27 + voitureA28:NB_ATTENTE_A_28 + voitureA29:NB_ATTENTE_A_29 + voitureA30:NB_ATTENTE_A_30 + voitureA31:NB_ATTENTE_A_31 + voitureA32:NB_ATTENTE_A_32 + voitureA33:NB_ATTENTE_A_33 + voitureA34:NB_ATTENTE_A_34 + voitureA35:NB_ATTENTE_A_35 + voitureA36:NB_ATTENTE_A_36 + voitureA37:NB_ATTENTE_A_37 + voitureA38:NB_ATTENTE_A_38 + voitureA39:NB_ATTENTE_A_39 + voitureA40:NB_ATTENTE_A_40 + voitureA41:NB_ATTENTE_A_41 + voitureA42:NB_ATTENTE_A_42 + voitureA43:NB_ATTENTE_A_43 + voitureA44:NB_ATTENTE_A_44 + voitureA45:NB_ATTENTE_A_45 + voitureA46:NB_ATTENTE_A_46 + voitureA47:NB_ATTENTE_A_47 + voitureA48:NB_ATTENTE_A_48 + voitureA49:NB_ATTENTE_A_49 + voitureA50:NB_ATTENTE_A_50 = 1
invariant :CAPACITE:CAPACITE_0 + SUR_PONT_A:SUR_PONT_A_0 + -1'ATTENTE_B:ATTENTE_B_0 + -1'ROUTE_B:ROUTE_B_0 + -1'SORTI_B:SORTI_B_0 = 0
invariant :sens0:CONTROLEUR_0 + sens0:CHOIX_0 + sens0:VIDANGE_0 + sens1:CONTROLEUR_1 + sens1:CHOIX_1 + sens1:VIDANGE_1 = 1
invariant :voitureB0:NB_ATTENTE_B_0 + voitureB1:NB_ATTENTE_B_1 + voitureB2:NB_ATTENTE_B_2 + voitureB3:NB_ATTENTE_B_3 + voitureB4:NB_ATTENTE_B_4 + voitureB5:NB_ATTENTE_B_5 + voitureB6:NB_ATTENTE_B_6 + voitureB7:NB_ATTENTE_B_7 + voitureB8:NB_ATTENTE_B_8 + voitureB9:NB_ATTENTE_B_9 + voitureB10:NB_ATTENTE_B_10 + voitureB11:NB_ATTENTE_B_11 + voitureB12:NB_ATTENTE_B_12 + voitureB13:NB_ATTENTE_B_13 + voitureB14:NB_ATTENTE_B_14 + voitureB15:NB_ATTENTE_B_15 + voitureB16:NB_ATTENTE_B_16 + voitureB17:NB_ATTENTE_B_17 + voitureB18:NB_ATTENTE_B_18 + voitureB19:NB_ATTENTE_B_19 + voitureB20:NB_ATTENTE_B_20 + voitureB21:NB_ATTENTE_B_21 + voitureB22:NB_ATTENTE_B_22 + voitureB23:NB_ATTENTE_B_23 + voitureB24:NB_ATTENTE_B_24 + voitureB25:NB_ATTENTE_B_25 + voitureB26:NB_ATTENTE_B_26 + voitureB27:NB_ATTENTE_B_27 + voitureB28:NB_ATTENTE_B_28 + voitureB29:NB_ATTENTE_B_29 + voitureB30:NB_ATTENTE_B_30 + voitureB31:NB_ATTENTE_B_31 + voitureB32:NB_ATTENTE_B_32 + voitureB33:NB_ATTENTE_B_33 + voitureB34:NB_ATTENTE_B_34 + voitureB35:NB_ATTENTE_B_35 + voitureB36:NB_ATTENTE_B_36 + voitureB37:NB_ATTENTE_B_37 + voitureB38:NB_ATTENTE_B_38 + voitureB39:NB_ATTENTE_B_39 + voitureB40:NB_ATTENTE_B_40 + voitureB41:NB_ATTENTE_B_41 + voitureB42:NB_ATTENTE_B_42 + voitureB43:NB_ATTENTE_B_43 + voitureB44:NB_ATTENTE_B_44 + voitureB45:NB_ATTENTE_B_45 + voitureB46:NB_ATTENTE_B_46 + voitureB47:NB_ATTENTE_B_47 + voitureB48:NB_ATTENTE_B_48 + voitureB49:NB_ATTENTE_B_49 + voitureB50:NB_ATTENTE_B_50 = 1
invariant :compteur0:COMPTEUR_0 + compteur1:COMPTEUR_1 + compteur2:COMPTEUR_2 + compteur3:COMPTEUR_3 + compteur4:COMPTEUR_4 + compteur5:COMPTEUR_5 + compteur6:COMPTEUR_6 + compteur7:COMPTEUR_7 + compteur8:COMPTEUR_8 + compteur9:COMPTEUR_9 + compteur10:COMPTEUR_10 = 1
Running compilation step : CommandLine [args=[gcc, -c, -I/home/mcc/BenchKit//lts_install_dir//include, -I., -std=c99, -fPIC, -O3, model.c], workingDir=/home/mcc/execution]
Compilation finished in 27871 ms.
Running link step : CommandLine [args=[gcc, -shared, -o, gal.so, model.o], workingDir=/home/mcc/execution]
Link finished in 153 ms.
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, ((X((LTLAP0==true)))U(<>((LTLAP1==true))))U((LTLAP2==true)), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 131 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-00 TRUE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ([](<>([]((LTLAP3==true)))))U([]((LTLAP4==true))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 3088 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-01 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
WARNING : LTSmin timed out (>225 s) on command CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP6==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2377 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-03 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP6==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2359 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-04 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, []((LTLAP6==true)), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2432 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-05 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP7==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2353 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-06 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(<>(<>((LTLAP2==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 108 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-07 TRUE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, []((LTLAP0==true)), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2981 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-08 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP6==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2528 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-09 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(X(X([](<>((LTLAP6==true)))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
WARNING : LTSmin timed out (>225 s) on command CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(X(X([](<>((LTLAP6==true)))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X([]((LTLAP8==true))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 300 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-11 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(<>(<>(((LTLAP9==true))U((LTLAP4==true))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 145244 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-12 TRUE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, [](<>([](<>(X((LTLAP1==true)))))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 328 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-13 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X((((LTLAP9==true))U((LTLAP3==true)))U((LTLAP7==true))), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 285 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-14 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, (LTLAP7==true), --buchi-type=spotba], workingDir=/home/mcc/execution]
LTSmin run took 2481 ms.
FORMULA BridgeAndVehicles-COL-V50P50N10-LTLFireability-15 FALSE TECHNIQUES PARTIAL_ORDER EXPLICIT LTSMIN SAT_SMT
Retrying LTSmin with larger timeout 1800 s
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
sparsehash FATAL ERROR: failed to allocate 37 groups
WARNING : LTSmin timed out (>1800 s) on command CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, -p, --pins-guards, --when, --ltl, ((LTLAP3==true))U(<>(((LTLAP5==true))U((LTLAP0==true)))), --buchi-type=spotba], workingDir=/home/mcc/execution]
Running LTSmin : CommandLine [args=[/home/mcc/BenchKit//lts_install_dir//bin/pins2lts-mc, ./gal.so, --threads=1, --when, --ltl, X(X(X([](<>((LTLAP6==true)))))), --buchi-type=spotba], workingDir=/home/mcc/execution]

BK_TIME_CONFINEMENT_REACHED

--------------------
content from stderr:

+ export BINDIR=/home/mcc/BenchKit/
+ BINDIR=/home/mcc/BenchKit/
++ pwd
+ export MODEL=/home/mcc/execution
+ MODEL=/home/mcc/execution
+ /home/mcc/BenchKit//runeclipse.sh /home/mcc/execution LTLFireability -its -ltsminpath /home/mcc/BenchKit//lts_install_dir/ -smt
+ ulimit -s 65536
+ [[ -z '' ]]
+ export LTSMIN_MEM_SIZE=8589934592
+ LTSMIN_MEM_SIZE=8589934592
+ /home/mcc/BenchKit//itstools/its-tools -consoleLog -data /home/mcc/execution/workspace -pnfolder /home/mcc/execution -examination LTLFireability -z3path /home/mcc/BenchKit//z3/bin/z3 -yices2path /home/mcc/BenchKit//yices/bin/yices -its -ltsminpath /home/mcc/BenchKit//lts_install_dir/ -smt -vmargs -Dosgi.locking=none -Declipse.stateSaveDelayInterval=-1 -Dosgi.configuration.area=/tmp/.eclipse -Xss8m -Xms40m -Xmx8192m -Dfile.encoding=UTF-8 -Dosgi.requiredJavaVersion=1.6
May 29, 2018 1:23:22 AM fr.lip6.move.gal.application.Application start
INFO: Running its-tools with arguments : [-pnfolder, /home/mcc/execution, -examination, LTLFireability, -z3path, /home/mcc/BenchKit//z3/bin/z3, -yices2path, /home/mcc/BenchKit//yices/bin/yices, -its, -ltsminpath, /home/mcc/BenchKit//lts_install_dir/, -smt]
May 29, 2018 1:23:22 AM fr.lip6.move.gal.application.MccTranslator transformPNML
INFO: Parsing pnml file : /home/mcc/execution/model.pnml
May 29, 2018 1:23:22 AM fr.lip6.move.gal.pnml.togal.PnmlToGalTransformer transform
INFO: Detected file is not PT type :http://www.pnml.org/version-2009/grammar/symmetricnet
May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.PnmlToGalTransformer transform
INFO: Load time of PNML (colored model parsed with PNMLFW) : 1674 ms
May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.HLGALTransformer handlePage
INFO: Transformed 15 places.
May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.HLGALTransformer handlePage
INFO: Computed order using colors.
May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.HLGALTransformer handlePage
INFO: sort/places :sens->CONTROLEUR,CHOIX,VIDANGE,
compteur->COMPTEUR,
Dot->CAPACITE,SORTI_A,ROUTE_A,ATTENTE_A,SUR_PONT_A,SUR_PONT_B,ATTENTE_B,ROUTE_B,SORTI_B,
voitureA->NB_ATTENTE_A,
voitureB->NB_ATTENTE_B,

May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.HLGALTransformer handlePage
INFO: Transformed 11 transitions.
May 29, 2018 1:23:24 AM fr.lip6.move.gal.pnml.togal.PnmlToGalTransformer transform
INFO: Computed order based on color domains.
May 29, 2018 1:23:24 AM fr.lip6.move.serialization.SerializationUtil systemToFile
INFO: Time to serialize gal into /home/mcc/execution/model.pnml.img.gal : 14 ms
May 29, 2018 1:23:26 AM fr.lip6.move.gal.application.MccTranslator applyOrder
INFO: Applying decomposition
May 29, 2018 1:23:26 AM fr.lip6.move.gal.instantiate.CompositeBuilder decomposeWithOrder
INFO: Decomposing Gal with order
May 29, 2018 1:23:26 AM fr.lip6.move.gal.instantiate.Instantiator instantiateParameters
INFO: On-the-fly reduction of False transitions avoided exploring 119.0 instantiations of transitions. Total transitions/syncs built is 358
May 29, 2018 1:23:27 AM fr.lip6.move.gal.instantiate.GALRewriter flatten
INFO: Flatten gal took : 199 ms
May 29, 2018 1:23:28 AM fr.lip6.move.gal.instantiate.CompositeBuilder rewriteArraysToAllowPartition
INFO: Rewriting arrays NB_ATTENTE_A, NB_ATTENTE_B, CONTROLEUR, CHOIX, COMPTEUR, VIDANGE to variables to allow decomposition.
May 29, 2018 1:23:28 AM fr.lip6.move.gal.instantiate.Instantiator fuseIsomorphicEffects
INFO: Removed a total of 245 redundant transitions.
May 29, 2018 1:23:31 AM fr.lip6.move.serialization.SerializationUtil systemToFile
INFO: Time to serialize gal into /home/mcc/execution/LTLFireability.pnml.gal : 26 ms
May 29, 2018 1:23:31 AM fr.lip6.move.serialization.SerializationUtil serializePropertiesForITSLTLTools
INFO: Time to serialize properties into /home/mcc/execution/LTLFireability.ltl : 94 ms
May 29, 2018 1:23:31 AM fr.lip6.move.gal.semantics.DeterministicNextBuilder getDeterministicNext
INFO: Input system was not deterministic with 11 transitions. Expanding to a total of 1471 deterministic transitions.
May 29, 2018 1:23:31 AM fr.lip6.move.gal.semantics.DeterministicNextBuilder getDeterministicNext
INFO: Determinization took 21 ms.
May 29, 2018 1:23:33 AM fr.lip6.move.gal.gal2smt.bmc.KInductionSolver computeAndDeclareInvariants
INFO: Computed 7 place invariants in 112 ms
May 29, 2018 1:23:34 AM fr.lip6.move.gal.gal2smt.bmc.KInductionSolver init
INFO: Proved 128 variables to be positive in 1275 ms
May 29, 2018 1:23:34 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeAblingMatrix
INFO: Computing symmetric may disable matrix : 1328 transitions.
May 29, 2018 1:23:34 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of disable matrix completed :0/1328 took 8 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 1:23:34 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Complete disable matrix. took 292 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 1:23:34 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeAblingMatrix
INFO: Computing symmetric may enable matrix : 1328 transitions.
May 29, 2018 1:23:35 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Complete enable matrix. took 201 ms. Total solver calls (SAT/UNSAT): 0(0/0)
May 29, 2018 1:24:47 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeCoEnablingMatrix
INFO: Computing symmetric co enabling matrix : 1328 transitions.
May 29, 2018 1:24:49 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(0/1328) took 2072 ms. Total solver calls (SAT/UNSAT): 1201(551/650)
May 29, 2018 1:24:53 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(3/1328) took 5919 ms. Total solver calls (SAT/UNSAT): 4798(590/4208)
May 29, 2018 1:24:57 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(6/1328) took 9908 ms. Total solver calls (SAT/UNSAT): 8386(629/7757)
May 29, 2018 1:25:01 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(9/1328) took 13841 ms. Total solver calls (SAT/UNSAT): 11965(668/11297)
May 29, 2018 1:25:04 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(11/1328) took 17022 ms. Total solver calls (SAT/UNSAT): 14346(694/13652)
May 29, 2018 1:25:09 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(13/1328) took 21725 ms. Total solver calls (SAT/UNSAT): 16723(720/16003)
May 29, 2018 1:25:13 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(16/1328) took 25814 ms. Total solver calls (SAT/UNSAT): 20281(759/19522)
May 29, 2018 1:25:17 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(19/1328) took 29772 ms. Total solver calls (SAT/UNSAT): 23830(798/23032)
May 29, 2018 1:25:21 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(22/1328) took 33740 ms. Total solver calls (SAT/UNSAT): 27370(837/26533)
May 29, 2018 1:25:25 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(25/1328) took 37620 ms. Total solver calls (SAT/UNSAT): 30901(876/30025)
May 29, 2018 1:25:29 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(28/1328) took 41326 ms. Total solver calls (SAT/UNSAT): 34423(915/33508)
May 29, 2018 1:25:33 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(31/1328) took 45262 ms. Total solver calls (SAT/UNSAT): 37936(954/36982)
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INFO: Computation of co-enabling matrix(34/1328) took 49181 ms. Total solver calls (SAT/UNSAT): 41440(993/40447)
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INFO: Computation of co-enabling matrix(618/1328) took 641661 ms. Total solver calls (SAT/UNSAT): 620297(5257/615040)
May 29, 2018 1:35:32 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(624/1328) took 644700 ms. Total solver calls (SAT/UNSAT): 624530(5257/619273)
May 29, 2018 1:35:35 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(629/1328) took 647718 ms. Total solver calls (SAT/UNSAT): 628030(5257/622773)
May 29, 2018 1:35:38 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(636/1328) took 650777 ms. Total solver calls (SAT/UNSAT): 632888(5257/627631)
May 29, 2018 1:35:42 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(644/1328) took 654125 ms. Total solver calls (SAT/UNSAT): 638380(5257/633123)
May 29, 2018 1:35:45 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(653/1328) took 657217 ms. Total solver calls (SAT/UNSAT): 644482(5257/639225)
May 29, 2018 1:35:48 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(661/1328) took 660450 ms. Total solver calls (SAT/UNSAT): 649838(5257/644581)
May 29, 2018 1:35:51 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(666/1328) took 663559 ms. Total solver calls (SAT/UNSAT): 653153(5257/647896)
May 29, 2018 1:35:54 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(675/1328) took 666765 ms. Total solver calls (SAT/UNSAT): 659057(5257/653800)
May 29, 2018 1:35:57 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(684/1328) took 669920 ms. Total solver calls (SAT/UNSAT): 664880(5257/659623)
May 29, 2018 1:36:00 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(693/1328) took 673001 ms. Total solver calls (SAT/UNSAT): 670622(5257/665365)
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INFO: Computation of co-enabling matrix(702/1328) took 676060 ms. Total solver calls (SAT/UNSAT): 676283(5257/671026)
May 29, 2018 1:36:07 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(711/1328) took 679185 ms. Total solver calls (SAT/UNSAT): 681863(5257/676606)
May 29, 2018 1:36:10 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(720/1328) took 682324 ms. Total solver calls (SAT/UNSAT): 687362(5257/682105)
May 29, 2018 1:36:13 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(726/1328) took 685652 ms. Total solver calls (SAT/UNSAT): 690983(5257/685726)
May 29, 2018 1:36:17 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(732/1328) took 689258 ms. Total solver calls (SAT/UNSAT): 694568(5257/689311)
May 29, 2018 1:36:20 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(737/1328) took 692361 ms. Total solver calls (SAT/UNSAT): 697528(5257/692271)
May 29, 2018 1:36:23 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(744/1328) took 695633 ms. Total solver calls (SAT/UNSAT): 701630(5257/696373)
May 29, 2018 1:36:26 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(755/1328) took 698858 ms. Total solver calls (SAT/UNSAT): 707977(5257/702720)
May 29, 2018 1:36:29 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(766/1328) took 701974 ms. Total solver calls (SAT/UNSAT): 714203(5257/708946)
May 29, 2018 1:36:32 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(777/1328) took 705018 ms. Total solver calls (SAT/UNSAT): 720308(5257/715051)
May 29, 2018 1:36:35 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(788/1328) took 708091 ms. Total solver calls (SAT/UNSAT): 726292(5257/721035)
May 29, 2018 1:36:39 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(799/1328) took 711310 ms. Total solver calls (SAT/UNSAT): 732155(5257/726898)
May 29, 2018 1:36:42 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(811/1328) took 714510 ms. Total solver calls (SAT/UNSAT): 738413(5257/733156)
May 29, 2018 1:36:45 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(823/1328) took 717613 ms. Total solver calls (SAT/UNSAT): 744527(5257/739270)
May 29, 2018 1:36:48 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(835/1328) took 720750 ms. Total solver calls (SAT/UNSAT): 750497(5257/745240)
May 29, 2018 1:36:51 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(847/1328) took 723864 ms. Total solver calls (SAT/UNSAT): 756323(5257/751066)
May 29, 2018 1:36:54 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(857/1328) took 726998 ms. Total solver calls (SAT/UNSAT): 761068(5257/755811)
May 29, 2018 1:36:57 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(870/1328) took 730049 ms. Total solver calls (SAT/UNSAT): 767087(5257/761830)
May 29, 2018 1:37:01 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(883/1328) took 733133 ms. Total solver calls (SAT/UNSAT): 772937(5257/767680)
May 29, 2018 1:37:04 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(894/1328) took 736617 ms. Total solver calls (SAT/UNSAT): 777755(5257/772498)
May 29, 2018 1:37:07 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(902/1328) took 739850 ms. Total solver calls (SAT/UNSAT): 781183(5257/775926)
May 29, 2018 1:37:10 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(916/1328) took 742993 ms. Total solver calls (SAT/UNSAT): 787028(5257/781771)
May 29, 2018 1:37:14 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(931/1328) took 746132 ms. Total solver calls (SAT/UNSAT): 793073(5257/787816)
May 29, 2018 1:37:17 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(946/1328) took 749246 ms. Total solver calls (SAT/UNSAT): 798893(5257/793636)
May 29, 2018 1:37:20 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(961/1328) took 752399 ms. Total solver calls (SAT/UNSAT): 804488(5257/799231)
May 29, 2018 1:37:23 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(966/1328) took 755490 ms. Total solver calls (SAT/UNSAT): 806303(5257/801046)
May 29, 2018 1:37:26 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(971/1328) took 759014 ms. Total solver calls (SAT/UNSAT): 808093(5257/802836)
May 29, 2018 1:37:30 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(980/1328) took 762346 ms. Total solver calls (SAT/UNSAT): 811252(5257/805995)
May 29, 2018 1:37:33 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(995/1328) took 765410 ms. Total solver calls (SAT/UNSAT): 816337(5257/811080)
May 29, 2018 1:37:36 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1013/1328) took 768537 ms. Total solver calls (SAT/UNSAT): 822142(5257/816885)
May 29, 2018 1:37:39 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1029/1328) took 771658 ms. Total solver calls (SAT/UNSAT): 827030(5257/821773)
May 29, 2018 1:37:42 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1044/1328) took 774787 ms. Total solver calls (SAT/UNSAT): 831380(5257/826123)
May 29, 2018 1:37:45 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1052/1328) took 777829 ms. Total solver calls (SAT/UNSAT): 833608(5257/828351)
May 29, 2018 1:37:48 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1062/1328) took 780926 ms. Total solver calls (SAT/UNSAT): 836303(5257/831046)
May 29, 2018 1:37:52 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1075/1328) took 784174 ms. Total solver calls (SAT/UNSAT): 839657(5257/834400)
May 29, 2018 1:37:55 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1082/1328) took 787237 ms. Total solver calls (SAT/UNSAT): 841393(5257/836136)
May 29, 2018 1:37:58 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1103/1328) took 790324 ms. Total solver calls (SAT/UNSAT): 846307(5257/841050)
May 29, 2018 1:38:01 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1127/1328) took 793333 ms. Total solver calls (SAT/UNSAT): 851383(5257/846126)
May 29, 2018 1:38:04 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1153/1328) took 796373 ms. Total solver calls (SAT/UNSAT): 856232(5257/850975)
May 29, 2018 1:38:07 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1179/1328) took 799540 ms. Total solver calls (SAT/UNSAT): 860405(5257/855148)
May 29, 2018 1:38:10 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1190/1328) took 802637 ms. Total solver calls (SAT/UNSAT): 861967(5257/856710)
May 29, 2018 1:38:13 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1203/1328) took 805661 ms. Total solver calls (SAT/UNSAT): 863657(5257/858400)
May 29, 2018 1:38:16 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1218/1328) took 808825 ms. Total solver calls (SAT/UNSAT): 865397(5257/860140)
May 29, 2018 1:38:19 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1239/1328) took 811881 ms. Total solver calls (SAT/UNSAT): 867455(5257/862198)
May 29, 2018 1:38:22 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1254/1328) took 814887 ms. Total solver calls (SAT/UNSAT): 868655(5257/863398)
May 29, 2018 1:38:26 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1277/1328) took 818127 ms. Total solver calls (SAT/UNSAT): 870058(5257/864801)
May 29, 2018 1:38:29 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of co-enabling matrix(1308/1328) took 821233 ms. Total solver calls (SAT/UNSAT): 871112(5257/865855)
May 29, 2018 1:38:29 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Finished co-enabling matrix. took 821972 ms. Total solver calls (SAT/UNSAT): 871283(5257/866026)
May 29, 2018 1:38:29 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver computeDoNotAccord
INFO: Computing Do-Not-Accords matrix : 1328 transitions.
May 29, 2018 1:38:37 AM fr.lip6.move.gal.gal2smt.bmc.NecessaryEnablingsolver printStats
INFO: Computation of Completed DNA matrix. took 8077 ms. Total solver calls (SAT/UNSAT): 205(0/205)
May 29, 2018 1:38:38 AM fr.lip6.move.gal.gal2pins.Gal2PinsTransformerNext transform
INFO: Built C files in 907053ms conformant to PINS in folder :/home/mcc/execution
ITS-tools command line returned an error code 1

Sequence of Actions to be Executed by the VM

This is useful if one wants to reexecute the tool in the VM from the submitted image disk.

set -x
# this is for BenchKit: configuration of major elements for the test
export BK_INPUT="BridgeAndVehicles-COL-V50P50N10"
export BK_EXAMINATION="LTLFireability"
export BK_TOOL="itstools"
export BK_RESULT_DIR="/tmp/BK_RESULTS/OUTPUTS"
export BK_TIME_CONFINEMENT="3600"
export BK_MEMORY_CONFINEMENT="16384"

# this is specific to your benchmark or test

export BIN_DIR="$HOME/BenchKit/bin"

# remove the execution directoty if it exists (to avoid increse of .vmdk images)
if [ -d execution ] ; then
rm -rf execution
fi

tar xzf /home/mcc/BenchKit/INPUTS/BridgeAndVehicles-COL-V50P50N10.tgz
mv BridgeAndVehicles-COL-V50P50N10 execution
cd execution
pwd
ls -lh

# this is for BenchKit: explicit launching of the test
echo "====================================================================="
echo " Generated by BenchKit 2-3637"
echo " Executing tool itstools"
echo " Input is BridgeAndVehicles-COL-V50P50N10, examination is LTLFireability"
echo " Time confinement is $BK_TIME_CONFINEMENT seconds"
echo " Memory confinement is 16384 MBytes"
echo " Number of cores is 4"
echo " Run identifier is r224-ebro-152732378700056"
echo "====================================================================="
echo
echo "--------------------"
echo "content from stdout:"
echo
echo "=== Data for post analysis generated by BenchKit (invocation template)"
echo
if [ "LTLFireability" = "UpperBounds" ] ; then
echo "The expected result is a vector of positive values"
echo NUM_VECTOR
elif [ "LTLFireability" != "StateSpace" ] ; then
echo "The expected result is a vector of booleans"
echo BOOL_VECTOR
else
echo "no data necessary for post analysis"
fi
echo
if [ -f "LTLFireability.txt" ] ; then
echo "here is the order used to build the result vector(from text file)"
for x in $(grep Property LTLFireability.txt | cut -d ' ' -f 2 | sort -u) ; do
echo "FORMULA_NAME $x"
done
elif [ -f "LTLFireability.xml" ] ; then # for cunf (txt files deleted;-)
echo echo "here is the order used to build the result vector(from xml file)"
for x in $(grep '' LTLFireability.xml | cut -d '>' -f 2 | cut -d '<' -f 1 | sort -u) ; do
echo "FORMULA_NAME $x"
done
fi
echo
echo "=== Now, execution of the tool begins"
echo
echo -n "BK_START "
date -u +%s%3N
echo
timeout -s 9 $BK_TIME_CONFINEMENT bash -c "/home/mcc/BenchKit/BenchKit_head.sh 2> STDERR ; echo ; echo -n \"BK_STOP \" ; date -u +%s%3N"
if [ $? -eq 137 ] ; then
echo
echo "BK_TIME_CONFINEMENT_REACHED"
fi
echo
echo "--------------------"
echo "content from stderr:"
echo
cat STDERR ;